Lattice Semiconductor Corporation
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LOW-POWER-CPLD-DESIGN IN DER PRAXIS

Dieser Inhalt wurde von Lattice Semiconductor Corporation veröffentlicht

Jeder Ingenieur, der sich mit tragbaren Produkten beschäftigt, weiß, dass die Minimierung des Stromverbrauchs eine absolute Voraussetzung für die heutigen Designs ist. Doch nur die erfahrenen unter ihnen verstehen die subtilen, aber wichtigen Details, die die Akkulaufzeit eines Systems maximieren können.

In diesem Whitepaper konzentriert sich Lattice Semiconductor darauf, wie diese erfahrenen Experten mit Hilfe von komplexen programmierbaren Logikbauelementen (CPLD) mit extrem niedriger Leistung jedes einzelne Mikrowatt aus den I/O-Subsystemen ihrer eingebetteten Designs herausholen. 

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